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HFB05-601-RC  HFA25PB60  HFA16TA60CSPBF  HFA30PA60CPBF  HFA40HF120C  HFA140MD60C  HFA08TB60SPBF  HFB06PB120  HFA16TA60CPBF  HFA60EA120P  
5AGTFB1G431C4N 阿里亚V器件手册 (Arria V Device Handbook)
.型号:   5AGTFB1G431C4N
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描述: 阿里亚V器件手册
Arria V Device Handbook
文件大小 :   1787 K    
页数 : 82 页
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品牌   ALTERA [ ALTERA CORPORATION ]
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1–18
第1章:为阿里亚V器件系列简介
的SoC FPGA与HPS
系统外设
以太网MAC , USB OTG控制器, NAND闪存控制器和SD / MMC / SDIO
控制器模块具有集成的DMA控制器。对于模块没有
集成的DMA控制器,一个附加的DMA控制器模块提供高达
8通道高带宽的数据传输。调试访问端口提供
接口行业标准的JTAG调试工具,支持ARM的CoreSight
调试和跟踪的核心,以促进软件开发。
HPS -FPGA AXI桥
在HPS -FPGA桥接,它支持高级微控制器总线
架构( AMBA
®
)高级可扩展接口( AXI
)规格,包括
:下面的桥
FPGA对HPS AXI桥支撑32,64高性能总线和
128位的数据宽度,允许在FPGA架构掌握交易数据到从站
在HPS
HPS到FPGA的AXI桥型高性能总线支持32-,64- ,和
128位的数据宽度,使高压钠灯掌握交易数据在从机
FPGA架构。
轻型HPS至FPGA AXI桥,较低性能的32位总线宽度
允许HPS掌握交易在FPGA架构的奴隶。
在HPS -FPGA AXI桥也让FPGA架构来访问共享内存
由一个或两个微处理器,以及提供异步时钟与交叉
从FPGA架构时钟。
HPS SDRAM控制器子系统
在HPS SDRAM控制器子系统包含多端口SDRAM控制器和
DDR PHY是在FPGA架构之间共享(通过
FPGA至HPS SDRAM接口) , 2级( L2)高速缓存,并且所述电平3( L3)的系统
互连。在FPGA到HPS SDRAM接口支持AMBA AXI和Avalon
®
内存映射(Avalon - MM )接口标准,并提供了多达四个端口
有独立的读写方向。
为了最大限度地提高内存性能,将HPS SDRAM控制器子系统支持
命令和数据的重新排序,亏损循环仲裁与衰老,和
高优先级的旁路功能。在HPS SDRAM控制器子系统支持DDR2 ,
DDR3 , LPDDR , LPDDR2或设备高达4GB ,运行高达533兆赫( 1066 Mbps的
数据速率)。
为了便于移植,在FPGA到HPS SDRAM接口与兼容
软SDRAM内存控制器IP和硬SDRAM存储器接口
控制器的FPGA架构。
FPGA配置和处理器引导
FPGA架构和HPS在SoC FPGA进行独立供电。您可以
降低时钟频率或栅极时钟以降低动态功率或关闭
关闭整个FPGA架构来降低系统总功耗。
您可以配置FPGA架构和引导HPS独立,以任何顺序,
为您提供更多的设计灵活性:
阿里亚V器件手册
第1卷:设备简介和数据表
2012年2月Altera公司
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