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5AGTFB1G431C4N 阿里亚V器件手册 (Arria V Device Handbook)
.型号:   5AGTFB1G431C4N
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描述: 阿里亚V器件手册
Arria V Device Handbook
文件大小 :   1787 K    
页数 : 82 页
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品牌   ALTERA [ ALTERA CORPORATION ]
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100%
第2章:对Arria V器件的设备数据表
开关特性
2–29
表2-25 。 PLL规格Arria V器件,初步
符号
dK
k
价值
f
水库
分数的分子
VCO频率分辨率(F
INPFD
= 100MHz)的
参数
Δ-Σ调制的比特数( DSM )
(1)
( 3个3部分)
待定
典型值
24
8388608
5.96
最大
待定
单位
Hz
注释
( 1 )待硅的表征。
(2)本说明书中在Quartus II软件由I / O的最大次数的限制。最大I / O频率是每一个不同的我/ O
标准。
(3)本说明书中是由两个较低的限制: I /作者
最大
或f
OUT
的锁相环。
( 4 )高输入抖动直接影响PLL输出抖动。具有低的PLL输出时钟抖动,则必须提供一个干净的时钟源< 120 ps的。
(5) F
REF
是FIN / N将N = 1 。
(6)峰 - 峰抖动为10的概率水平
–12
(14西格玛, 99.99999999974404 %置信水平) 。输出抖动规范适用于
在PLL中,当30ps的输入抖动施加的固有抖动。外部存储器接口的时钟输出的抖动规范使用一个不同的
测定方法中,并且在可用的
(7)在级联的PLL规范仅适用具备以下条件:
一。上游PLL : 0.59兆赫
上游PLL BW < 1兆赫
B.下游PLL :下游PLL BW > 2兆赫
(8)在外部反馈模式不支持高带宽的PLL设置。
( 9),外部存储器接口的时钟输出的抖动规范使用不同的测量方法,该方法是在可用的
DSP模块规范
列出了Arria V DSP模块的性能规格。
表2-26 。 DSP模块的性能规格Arria V器件,初步
性能
模式
–C4
速度
GRADE
370
370
370
310
370
370
370
370
370
310
370
-C5 , I5
速度
GRADE
310
310
310
250
310
310
310
310
310
250
310
–C6
速度
GRADE
220
220
220
200
220
220
220
220
220
200
220
单位
使用一个DSP块模式
独立的9× 9的乘法
独立的18 ×19乘法
独立的18 ×18乘法
独立的27 ×27乘法
独立的18 ×25乘法
独立的20× 24乘法
两个18× 19乘法器加法器模式
18 ×18乘法器添加总结与36位输入
使用两个DSP模块模式
复杂的18× 19乘法
两个27 ×27乘法器加法器
4个18 ×19乘法器加法器
兆赫
兆赫
兆赫
兆赫
兆赫
兆赫
兆赫
兆赫
兆赫
兆赫
兆赫
2012年2月
Altera公司。
阿里亚V器件手册
第1卷:设备简介和数据表
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