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5AGTFD3G427C4N 阿里亚V器件手册 (Arria V Device Handbook)
.型号:   5AGTFD3G427C4N
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描述: 阿里亚V器件手册
Arria V Device Handbook
文件大小 :   1787 K    
页数 : 82 页
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品牌   ALTERA [ ALTERA CORPORATION ]
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第1章:为阿里亚V器件系列简介
时钟网络和PLL时钟源
1–15
时钟网络和PLL时钟源
阿里亚V时钟网络的体系结构是基于Altera成熟可靠的全球性,象限,
和外设时钟结构,这是支持专用时钟输入管脚和
分数锁相环。 Arria V器件具有16个全局时钟网络可达的能力
625 MHz的操作。 Quartus II软件识别时钟的所有未使用的部分
网络和它们关断,从而降低了功耗。
Arria V器件具有多达16个锁相环,每个PLL 18输出计数器。一个分数
PLL可以使用多达18个输出计数器和两个相邻的分数锁相环共享18
输出计数器。你可以用小数锁相环来降低振荡器的数量
通过减少在该装置中使用的时钟引脚上的电路板所需,以及
从一个单一的参考时钟源合成的多个时钟频率。您可以
采用锁相环频率合成,片上时钟去歪斜,抖动衰减,
动态相移,零延迟缓冲器,计数器重新配置,带宽
重新配置,可编程输出时钟占空比,级联PLL和
参考时钟切换。
Arria V器件使用一个小数分频PLL架构,除了历史悠久的整数
PLL 。当您使用小数分频PLL模式时,您可以使用PLL用于精密
分数N频率合成-不再需要一个片外参考时钟。
收发信机部分的锁相环中,当不使用收发的I / O ,可以作为
通用分数锁相环的FPGA架构。
2012年2月
Altera公司。
阿里亚V器件手册
第1卷:设备简介和数据表
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