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HY6316100ALJ-25  HY638100AJ-15  HY6316100AJ-20  HY63V16100AJ-20  HY638100AT2-15  HY6316100ALR-17  HY638256LT1-15  HY638100LT2-25  HY638100J-25  HY638256P-15  
5AGTMB1G627C4N 阿里亚V器件手册 (Arria V Device Handbook)
.型号:   5AGTMB1G627C4N
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描述: 阿里亚V器件手册
Arria V Device Handbook
文件大小 :   1787 K    
页数 : 82 页
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品牌   ALTERA [ ALTERA CORPORATION ]
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100%
第2章:对Arria V器件的设备数据表
配置说明
2–41
FPP配置时序时, DCLK到DATA [] > 1
显示了使用MAX II时的FPP配置的时序波形
设备或微处理器作为外部主机。该波形示出了定时时
DCLK到DATA [ ]比
大于1 。
图2-6 。 FPP配置时序波形当DCLK到DATA [ ]比>1
t
CF2ST1
t
CFG
送到nCONFIG
t
CF2CK
的nSTATUS
(3)
CONF_DONE
(4)
t
状态
t
CF2ST0
t
CF2CD
t
CL
t
CH
t
ST2CK
(8)
2
t
CLK
DCLK
(6)
1
2
WORD 0
r
1
r
(7)
1
WORD 3
r
1
2
(5)
用户模式
用户模式
DATA[15..0]
(8)
t
DSU
WORD 1
t
DH
字( N-1 )字
n
t
DH
用户I / O
高-Z
INIT_DONE
(9)
t
CD2UM
注释
( 1 )要查找
DCLK到DATA [ ]
比你的系统,请参阅
(2)该波形的开头示出了设备中的用户模式。在用户模式下,
送到nCONFIG ,的nSTATUS ,
CONF_DONE
处于逻辑高电平。
送到nCONFIG
被拉低时,重新配置周期开始。
( 3 )上电后,阿里亚V器件持有
的nSTATUS
低所指定的POR延迟的时间。
( 4 )上电后,之前和配置过程中,
CONF_DONE
是低的。
( 5 )不要离开
DCLK
配置后的浮动。你可以驾驶它高或低,取其更方便。
(6)的“r”表示所述
DCLK到DATA [ ]
比。对于
DCLK到DATA [ ]
比基础上,解压缩和设计安全特性使
设置,请参考
(7)如果需要的话,暂停
DCLK
通过保持为低电平。当
DCLK
重新启动后,外部主机必须提供的资料
DATA[15..0]
在发送之前销
第一
DCLK
上升沿。
( 8 )要确保成功的配置,将整个配置数据的Arria V器件。
CONF_DONE
发布了Arria V器件后高
成功接收的所有配置数据。后
CONF_DONE
变高,就派两个额外的下降沿
DCLK
开始初始化
并进入用户模式。
( 9 )当选择位,使
INIT_DONE
销被构造成装置中,所述
INIT_DONE
变低。
2012年2月
Altera公司。
阿里亚V器件手册
第1卷:设备简介和数据表
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