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5M240ZF64I4N MAX V器件手册 (MAX V Device Handbook)
.型号:   5M240ZF64I4N
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描述: MAX V器件手册
MAX V Device Handbook
文件大小 :   4016 K    
页数 : 166 页
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品牌   ALTERA [ ALTERA CORPORATION ]
购买 :   
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2–6
第2章: MAX V架构
逻辑阵列模块
LAB互连
同一LAB中的列和行互连和LE输出驱动LAB
本地互连。相邻LAB ,从左侧和右侧,也可以驱动一个LAB的
通过的DirectLink连接的本地互连。该连接的DirectLink
功能最大限度地减少使用行和列互连,提供更高
性能和灵活性。每个LE可以驱动其他30个LE ,通过快速的本地和
的DirectLink互连。
显示的DirectLink连接。
图2-4 。的DirectLink连接
来自的DirectLink互连
离开实验室或IOE输出
来自的DirectLink互连
右室或IOE输出
LE0
LE1
LE2
LE3
LE4
的DirectLink
互联
向左
当地
互联
LE5
LE6
LE7
LE8
LE9
逻辑元件
LAB
的DirectLink
互联
向右
LAB控制信号
每个LAB包含专用逻辑,用于驱动控制信号提供给它的LE 。控制
信号包括两个时钟,两个时钟使能,两个异步清零,一
同步清零,异步预置/负载,同步负荷,
加/减控制信号,在一个时间提供最多10个控制信号。
同步加载和明确的信号,实现计数器时,一般使用
但它们也可以用于其它功能。
每个LAB可以使用两个时钟和两个时钟使能信号。每个LAB的时钟和
时钟使能信号被连接。例如,任何LE在一个特定的实验室使用
labclk1
信号也使用
labclkena1.
如果在实验室使用的上升沿和下降沿都
一个时钟,它也同时使用了,LAB-宽的时钟信号。拉高时钟使能
信号关闭LAB全时钟。
每个LAB可以使用两个异步清零信号,异步加载/预设
信号。默认情况下, Quartus II软件使用
回推门技术
达到预设。如果禁用
门推回期权或指定一个特定的寄存器
以电高使用Quartus II软件,预置,然后用获得的
异步加载数据输入的异步加载信号拉高。
MAX V器件手册
2010年12月
Altera公司。
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