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5M240ZF64I4N MAX V器件手册 (MAX V Device Handbook)
.型号:   5M240ZF64I4N
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描述: MAX V器件手册
MAX V Device Handbook
文件大小 :   4016 K    
页数 : 166 页
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品牌   ALTERA [ ALTERA CORPORATION ]
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100%
第2章: MAX V架构
逻辑元件
2–13
Quartus II软件的设计过程中自动创建进位链逻辑
处理,或者你也可以手动设计输入过程中创建它。参数
功能,如LPM功能自动拍摄进位链的优势
相应的功能。 Quartus II软件生成的进位链长度超过10个LE
通过将同一行内相邻LAB一起自动完成。进位链
可以沿水平方向延伸至一个完整的LAB行,但LAB之间没有延伸
行。
清零和预设逻辑控制
LAB-宽信号对控制寄存器的清晰,预置信号的逻辑。勒
直接支持异步清零和预设功能。寄存器预设为
通过逻辑高电平的异步加载来实现。 MAX V器件支持
同时预置/异步加载和明确的信号。异步清零
信号的优先级,如果两个信号同时有效。每个LAB
最多两个清漆和一个预置信号支持。
除了明确和预设的端口, MAX V器件提供一个芯片全复位销
( DEV_CLRn )重置所有寄存器中的设备。在编译之前,设置一个选项
Quartus II软件控制该引脚。该芯片全复位覆盖所有其他
控制信号,并使用其自己的专用布线资源,而无需使用任何的
4全球资源。推动这一信号为低之前或上电时防止
从设计中释放清漆用户模式。这使您可以控制何时
明确发布了刚刚加电的设备上。如果不是因为它的芯片集全
复位功能,在
DEV_CLRn
脚是一个普通的I / O引脚。
默认情况下, MAX V器件的所有寄存器被设置为开机低。然而,这
电状态可以设计输入过程中使用被设置为高个体登记
Quartus II软件。
LE RAM
在Quartus II内存编译器可以配置未使用的LE为LE RAM 。
MAX V器件支持以下内存类型:
FIFO的同步读/写
异步FIFO的读/写
1端口SRAM
2端口SRAM
3端口SRAM
移位寄存器
f
有关内存的更多信息,请参阅
2010年12月
Altera公司。
MAX V器件手册
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