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AD5449  TA8529F  AD5432BRM  AD5450  TA8751AN  TA8867BN  AD5447  AD5446  TA8552AFN  TA8795BF  
5M240ZF64I4N MAX V器件手册 (MAX V Device Handbook)
.型号:   5M240ZF64I4N
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描述: MAX V器件手册
MAX V Device Handbook
文件大小 :   4016 K    
页数 : 166 页
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品牌   ALTERA [ ALTERA CORPORATION ]
购买 :   
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100%
2–10
第2章: MAX V架构
逻辑元件
普通模式
正常模式是适用于一般逻辑应用和组合
功能。在正常模式下,来自LAB局部互连四个数据输入是
输入到一个4输入LUT ,如图
在Quartus II编译器
自动选择进位或
data3
信号作为输入到LUT之一。
每个LE可以使用LUT链连接,以驱动其组合直接输出到
接下来LE的LAB 。用于寄存器异步加载数据来自
data3
在LE的输入。的LE在正常模式下支持包装寄存器。
图2-7 。 LE在正常模式
SLOAD
sclear
( LAB
宽)
( LAB
宽)
寄存器链
连接
aload
( LAB
宽)
addnsub ( LAB
宽)
(1)
data1
data2
data3
CIN (从COUT
以前的LE )
data4
4-Input
LUT
ALD / PRE
ADATA Q
D
ENA
CLRN
行,列和
的DirectLink路由
行,列和
的DirectLink路由
时钟( LAB
宽)
ENA ( LAB
宽)
ACLR ( LAB
宽)
本地路由
LUT链
连接
注册
链输出
寄存器反馈
注意
(1)该信号是只允许在正常模式下,如果LE是一加法器/减法器链之后。
动态算术模式
动态运算方式,非常适合实现加法器,计数器,
蓄能器,宽校验功能,和比较。勒动态算术
模式使用四个2输入LUT配置为动态加法/减法器。第一
两个2输入LUT计算根据一个可能的进位的1或0 2求和;该
其他两个LUT产生的随身选择电路的两条链进位输出。
如图
劳顾会进位信号或者选择
carry-in0
or
carry-in1
链。依次选定链的逻辑电平决定了并行
总和被生成为一个组合或注册的输出。例如,当
执行一个加法器,相加输出是两个可能计算出的选择
金额:
数据1 +数据2 +随身IN0
or
数据1 +数据2 +随身IN1
MAX V器件手册
2010年12月
Altera公司。
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