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DIFFCLK_1N 的Cyclone III器件手册 (Cyclone III Device Handbook)
.型号:   DIFFCLK_1N
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描述: 的Cyclone III器件手册
Cyclone III Device Handbook
文件大小 :   7302 K    
页数 : 274 页
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品牌   ALTERA [ ALTERA CORPORATION ]
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100%
在Cyclone III器件系列SEU缓解:第11章
软件支持
11–9
列出了所见即所得的原子的Cyclone III器件系列的名称。
表11-7 。所见即所得的原子
设备
的Cyclone III
的Cyclone III LS
所见即所得的Atom
的Cyclone III CRC块
的Cyclone III ls_crcblock
1
使
的Cyclone III CRC块
在原始版本8.0 SP1或更早的
Quartus II软件,打开的错误检测功能CRC
设备和销
选项
对话框。这是当您使用8.1以后的版本,而不是要求
Quartus II软件。
示出了如何定义的一个的输入和输出端口的一例
所见即所得原子在Cyclone III LS器件。
例11-1 。错误检测框图
cycloneiiils_crcblock<crcblock_name>
(
.clk ( <clock source> )
.shiftnld ( <shiftnld source> )
.ldsrc ( <ldsrc source> )
.crcerror ( <crcerror出destination> )
.regout ( <output destination> )
.cyclecomplete ( <cyclecomplete destination> )
);
列出了必须包含在该原子上的输入和输出端口。该
原子对Cyclone III器件系列的输入和输出端口都差不多,除了
对于
完整的周期
端口这是唯一的Cyclone III LS器件。
表11-8 。 CRC块输入和输出端口
PORT
<crcblock_name>
输入/输出
输入
(第2部1 )
德网络nition
唯一标识符的CRC块,并表示任何标识符名称是
法律对于给定的描述语言(例如Verilog HDL语言,VHDL
AHDL ) 。这是必填栏。
这个信号表示该单元的时钟输入。这个小区的所有操作都
相对于该时钟的上升沿。无论是在装载
数据到单元或数据出细胞,它总是发生在上升沿。
该端口是必需的。
这个信号是一个输入到差错检测块。如果
shiftnld=1,
数据被从内部移位寄存器移位到
REGOUT
在每个上升沿
of
CLK 。
If
shiftnld=0,
移位寄存器并行装载无论是
预先计算的CRC值或根据所述更新寄存器的内容
LDSRC
端口输入。该端口是必需的。
.clk ( <clock
源>
输入
.shiftnld
( <shiftnld
source> )
输入
2011年12月
Altera公司。
的Cyclone III器件手册
第1卷
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