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DIFFCLK_4P 的Cyclone III器件手册 (Cyclone III Device Handbook)
.型号:   DIFFCLK_4P
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描述: 的Cyclone III器件手册
Cyclone III Device Handbook
文件大小 :   7302 K    
页数 : 274 页
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品牌   ALTERA [ ALTERA CORPORATION ]
购买 :   
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100%
11–10
在Cyclone III器件系列SEU缓解:第11章
恢复从CRC错误
表11-8 。 CRC块输入和输出端口
PORT
输入/输出
( 2/2 )
德网络nition
.ldsrc
( <ldsrc
source> )
输入
这个信号是一个输入到差错检测块。如果
ldsrc=0,
预先计算的CRC寄存器被选择用于装载到32位移位寄存器
在上升沿
CLK
shiftnld=0.
If
ldsrc=1,
签名
寄存器( CRC计算的结果)被选择用于装载到移位
注册处的上升沿
CLK
shiftnld=0.
这个端口被忽略
shiftnld=1.
该端口是必需的。
这个信号是同步的内部的电池的输出
该装置(80 - MHz内部振荡器)的振荡器,而不是到
CLK
端口。它
断言高,如果误差块检测到SRAM位已经翻转和
内部CRC计算已经显示出对于一个差的预
计算值。这个信号必须连接到输出引脚或
双向引脚。如果它连接到一个输出引脚,你只能监视
CRC_ERROR引脚
(芯不能访问此输出)。如果
CRC_ERROR
信号被用于由核心逻辑读取错误检测逻辑,该信号必须是
连接到
双向
引脚。该信号被馈送馈送到芯间接
双向
销具有其输出使能端口连接至VCC (图
这个信号是错误检测移位的输出寄存器同步于
CLK
口,由核心逻辑读取。它改变一个位在每个周期,所以你
应时钟
CLK
信号31的周期中读出的32位的移位
注册。
这个信号是用于
的Cyclone III ls_crcblock
只。该输出信号是
同步到设备的内部振荡器(80 - MHz内部
振荡器) ,并且不向
CLK
端口。该信号置为高电平一个时钟
每次旋风错误检测旋风完成时间。
.crc错误
( <crc错误
指标
output> )
产量
.regout
( <注册
output> )
产量
.cyclecomplete
( <cyclone
完整的指标
output> )
产量
恢复从CRC错误
该Altera FPGA中驻留在必须控制装置重新配置系统。后
检测在一个错误
CRC_ERROR
针,选通
送到nCONFIG
低指挥系统
到一次执行该重新配置时,它是安全的系统重新配置
FPGA中。
当数据位是通过重新配置器件改写为正确的值,则
设备功能正常。
虽然软错误是罕见的Altera器件,某些高可靠性应用
可能需要设计考虑到这些错误。
文档修订历史记录
列出的修订历史本文件。
表11-9 。文档修订历史( 2个第1部分)
日期
2011年12月
2009年12月
VERSION
变化
更新
更新超链接。
轻微的文字编辑。
2.3
2.2
小的改动的文本。
的Cyclone III器件手册
第1卷
2011年12月Altera公司
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