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EP1810 Altera的经典系列器件提供了一个解决方案,高速,低功率逻辑整合。制造在先进的CMOS技术 (The Altera Classic device family offers a solution to high-speed, lowpower logic integration. Fabricated on advanced CMOS technology)
.型号:   EP1810
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描述: Altera的经典系列器件提供了一个解决方案,高速,低功率逻辑整合。制造在先进的CMOS技术
The Altera Classic device family offers a solution to high-speed, lowpower logic integration. Fabricated on advanced CMOS technology
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品牌   ALTERA [ ALTERA CORPORATION ]
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100%
经典EPLD系列数据手册
一般
描述
Altera的经典
TM
器件系列提供了一个解决方案,以高速,低
功率逻辑整合。制造在先进的CMOS技术,
经典的器件还具有一个涡轮的唯一版本,其在此描述
数据表。
经典的设备支持100 % TTL仿真,并且可以轻松地集成
密度为300到多个PAL-和GAL型器件
900可用门。经典系列提供了引脚对引脚的逻辑延误
低到10毫微秒和计数器频率高达100兆赫。经典设备
可在很宽的范围内包,包括陶瓷双列直插式
封装( CERDIP ) ,塑料双列直插式封装( PDIP ) ,塑胶J引线芯片
载体( PLCC) ,陶瓷的J形引线芯片载体( JLCC ) ,针栅阵列(PGA),
和小外形集成电路( SOIC )封装。
基于EPROM的经典设备可以降低工作功耗
在不牺牲性能。这降低了功耗
使得经典系列非常适合于各种低功耗
应用程序。
经典的设备100 %一般在窗口测试设备
包,并且可以用紫外( UV)光被删除,从而允许设计
变化被迅速执行。
经典的设备使用加总的产品逻辑和可编程寄存器。
加总的副产物的逻辑提供一个可编程和/固定或
能够实现逻辑与多达8个乘积项的结构。该
可编程寄存器可以单独编程为D,T , Sr,或者
JK触发器的操作,也可以绕过组合操作。在
此外,宏小区的寄存器可以单独时钟或者通过一个全球
时钟或通过任何输入或反馈路径
数组。 Altera的
专有的可编程I / O架构,允许设计者
对于组合或注册程序的输出和反馈路径
运行在这两个高电平有效和低电平有效模式。这些特点使
它可以同时实现各种逻辑功能。
经典的设备由Altera公司的MAX + PLUS II开发支持
系统中,一个单一的,集成的软件包,提供了原理图, textÑincluding
VHDL , Verilog HDL语言,以及Altera硬件描述语言
( AHDL ) - 和波形设计输入,编译和逻辑综合,
仿真和时序分析和器件编程。该
MAX + PLUS II软件提供EDIF 2 0 0 3 0 0 , LPM , VHDL ,
Verilog HDL语言,和其他接口的附加设计输入和
仿真支持其他行业标准的PC和工作站 -
基于EDA工具。在MAX + PLUS II软件在基于Windows的运行
个人电脑,以及太阳SPARC工作站, HP 9000系列700/800 ,和IBM RISC
系统/ 6000工作站。这些器件还包含板载逻辑测试
电路允许在功能和AC特定网络阳离子VERI网络阳离子
标准生产溢流。
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Altera公司。
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