电子元器件数据表 IC PDF查询
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SMAJ15A  ICL7622AMJD  VBC315027ATDCA  VI-JNDCZ  PSCD-0504-150K-B  MC3S12XEP100F1VVLR  LP2987AIMM-5.0  ATV2500L  PMR8050-E-R050-A-2-B  VAC100A48D  
EP1810 Altera的经典系列器件提供了一个解决方案,高速,低功率逻辑整合。制造在先进的CMOS技术 (The Altera Classic device family offers a solution to high-speed, lowpower logic integration. Fabricated on advanced CMOS technology)
.型号:   EP1810
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描述: Altera的经典系列器件提供了一个解决方案,高速,低功率逻辑整合。制造在先进的CMOS技术
The Altera Classic device family offers a solution to high-speed, lowpower logic integration. Fabricated on advanced CMOS technology
文件大小 :   643 K    
页数 : 42 页
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品牌   ALTERA [ ALTERA CORPORATION ]
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100%
经典EPLD系列数据手册
EP610 , EP610I , EP910和EP910I设备具有全局反馈
CON组fi guration ;无论是宏蜂窝输出( Q)或I / O引脚输入( I / O)
可以喂回给
阵列放置,使得它可以访问所有其它
宏单元。
EP1810宏单元可以有两种反馈的配置:
象限或双。大部分宏在EP1810器件有一个象限
反馈配置;无论是宏单元输出或I / O引脚输入即可
反馈到其它宏小区在同一象限内。在选定的宏
EP1810器件具有双反馈配置:的输出
宏蜂窝反馈到其它宏小区在同一象限内,并且该
I / O引脚输入反馈到设备中的所有宏。如果相关联的
I / O引脚不使用,宏蜂窝输出可以选择养活所有
宏小区中的设备。在这种情况下,宏小区的输出传递
通过该三态缓冲器,并使用缓冲液之间的反馈路径
和I / O引脚。
设计安全性
经典的器件包含一个可编程安全位控制访问
的数据编程到设备中。当该位被编程,一
在该设备中实现专有设计不能被复制或
检索。这个特征提供设计安全性,因为高水平的
配置元素中的数据是不可见的。安全位的
控制这个功能和其他节目数据仅当复位
设备被擦除。
设备定时可以与MAX + PLUS II软件进行分析,以
各种流行的工业标准的EDA仿真和时序
分析仪,或与定时模型示于
图4中。
设备有固定的
内部延迟,允许用户以确定最坏情况下的定时
任何设计。在MAX + PLUS II软件提供时序仿真,
点至点的延迟预测,并为系统 - 详细的时序分析
级性能评估。
时序模型
图4.标准时序模型
全局时钟
延迟
t
ICS
输入
延迟
t
IN
阵列时钟
延迟
t
IC
逻辑阵列
延迟
t
LAD
t
CLR
I / O
延迟
t
IO
反馈
延迟
t
FD
注册
t
SU
t
H
产量
延迟
t
OD
t
XZ
t
ZX
750
Altera公司。
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