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A2M1CCP12VDC1.9  A2M1BSQ6VDC1.6D1  A2M1CCP24VDC1.92D  A2M1CSP12VDC1.9R  A2M1CSP12VDC1.9D  A2M1CCQ12VDC1.6DR  A2M1CCQ6VDC1.6DR  A2M1CCP12VDC1.9D1  A2M1CSP12VDC1.6DR  A2M1BSQ24VDC1.9DR  
EP1AGX50CF780I6N 第一节的Arria GX器件数据手册 (Section I. Arria GX Device Data Sheet)
.型号:   EP1AGX50CF780I6N
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描述: 第一节的Arria GX器件数据手册
Section I. Arria GX Device Data Sheet
文件大小 :   3509 K    
页数 : 234 页
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品牌   ALTERA [ ALTERA CORPORATION ]
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100%
4–32
第4章: DC和开关特性
典型设计性能
表4-47 。
默认情况下不同我的装载/为阿里亚GX器件( 2/2 ) O标准
I / O标准
1.8 V
1.5 V
PCI
PCI -X
SSTL - 2 I类
SSTL - 2级II
SSTL - 18 I级
SSTL - 18 II类
1.5 -V HSTL I类
1.5 -V HSTL II类
1.8 -V HSTL I类
1.8 -V HSTL II类
差分SSTL - 2 I类
差分SSTL - 2级II
差分SSTL - 18 I级
差分SSTL - 18 II类
1.5 - V I差分HSTL类
1.5 V差分HSTL II类
1.8 V I差分HSTL类
1.8 V差分HSTL II类
LVDS
容性负载
0
0
10
10
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
单位
pF
pF
pF
pF
pF
pF
pF
pF
pF
pF
pF
pF
pF
pF
pF
pF
pF
pF
pF
pF
pF
典型设计性能
以下部分描述了典型的设计表现为阿里亚GX
器件系列。
用户I / O引脚的时序
通过
显示用户输入的Arria GX器件I / O引脚的时序。 I / O
缓冲器T
SU
, t
H
和叔
CO
报告的情况下,当I / O时钟由一个驱动
非PLL全局时钟( GCLK )和锁相环(PLL)驱动的全局时钟( GCLK - PLL) 。对于T
SU
, t
H
,
和T
CO
使用区域时钟,从列出的每个设备的加法表中添加值
GCLK /全局时钟, PLL
值的装置。
EP1AGX20 I / O时序参数
通过
显示的最大I / O时序参数
EP1AGX20设备,需要支持通用I / O引脚的I / O标准。
介绍了该行针延迟加法器使用的区域时钟时
的Arria GX器件。
阿里亚GX器件手册,卷1
© 2009年12月
Altera公司。
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