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TF-TKS-G30-5315-002-AT  0322009.MXP  0322025.HXP  TF-PER-C10L-A10  TF-PCM-LN02-A10  0322002.HXP  XTX-945GSE  0322008.MXP  TKS-G20-9455  TKS-G21-CV05-002-DX  
AT40K05-2BQC 5K - 50K盖茨FPGA协处理器与FreeRAM (5K - 50K Gates Coprocessor FPGA with FreeRAM)
.型号:   AT40K05-2BQC
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描述: 5K - 50K盖茨FPGA协处理器与FreeRAM
5K - 50K Gates Coprocessor FPGA with FreeRAM
文件大小 :   1491 K    
页数 : 67 页
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品牌   ATMEL [ ATMEL CORPORATION ]
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100%
电池连接
校车接送飞机)五纵局部总线( 1元校车接送飞机) 。
图4中。
电池连接
CELL
CELL
CELL
飞机5
飞机4
平面3
平面2
平面1
CELL
CELL
CELL
飞机5
飞机4
平面3
平面2
平面1
�½
布辛平面
WXYZL
W
X
Y
Z
L
CELL
�½
垂直
布辛平面
对角线
直接连接
CELL
CELL
正交
直接连接
CELL
(一)细胞与细胞间的连接
( b)细胞对总线连接
小区
通门是独立的。可编程多路复用器和选通门的所有排列
是合法的。 V
n
(V
1
- V
5
)被连接到在平面Π垂直的局部总线。 ħ
n
(H
1
- H
5
)是
连接到在平面上的横向局部总线
n
。本地/本地转平面n的实现
通过打开连接到V的两个通过门
n
和H
n
。传输门被打开以让
信号转换成从一个本地总线或细胞出驱动信号到一个局部总线。信号
进入一个局部总线平面上的逻辑单元可以通过切换到另一架飞机
打开两个通门。这使得总线信号转换架来实现
更大的路由能力。同时最多5个本地/本地圈是可能的。
该AT40K / AT40KLV FPGA核心单元是基于一个高度可配置逻辑块
两个3输入LUT (8× 1 ,ROM) ,其可被组合以产生一个4输入的LUT 。
这意味着,任何核心单元可以实现的3个输入端的两个函数或一个函数
4路输入。有一个置位/复位D触发器的每一个细胞中,其输出的可能是三
陈述和核心单元内反馈回国内。还有一个2至1多路转换器在
每一个细胞,并在细胞中的“前端”的上游与门。此与门是一个
在高效的阵列乘法器的实现的重要功能。
在每个核心单元这样的功能,在核心单元可以以几种配置
“模式” 。核心单元的灵活性使得AT40K / AT40KLV架构非常适合
大部分数字化设计的应用领域,见图6 。
8
AT40K / AT40KLV系列FPGA
0896C–FPGA–04/02
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