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SN74LS240NE4  SN74LS240DBR  SN74LS258BNSRE4  SN74LS258BN  SN74LS257BNSRG4  SN74LS240NSR  SN74LS240DW  SN74LS241  SN74LS241DWE4  SN74LS258BDRE4  
ADS7864YB 为500kHz , 12位, 6通道同步采样模拟数字转换器 (500kHz, 12-Bit, 6-Channel Simultaneous Sampling ANALOG-TO-DIGITAL CONVERTER)
.型号:   ADS7864YB
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描述: 为500kHz , 12位, 6通道同步采样模拟数字转换器
500kHz, 12-Bit, 6-Channel Simultaneous Sampling ANALOG-TO-DIGITAL CONVERTER
文件大小 :   184 K    
页数 : 16 页
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品牌   BB [ BURR-BROWN CORPORATION ]
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100%
时间, HOLDB的下降沿发生之前的
时钟的下降沿。一次转换需要16个时钟
周期。这里,数据被读出之后的下一个转换是initi-
通过HOLDB ated 。读取通道B的数据, A1设置
高和A2是低的。作为A0低一读期间( A2
A1 A0 = 010)数据B0被放置到输出。前一秒
RD , A0切换高( A2 A1 A0 = 011 ),因此从数据
信道B1被读取。
读取数据( RD , CS ) -In
一般情况下,信道/数据
输出处于三态。在这两方面, CS和RD必须低到
启用这些输出。 RD和CS必须保持低电平在一起
用于至少为30ns (图10 ,叔
13
)的输出数据是前
有效的。 RD必须保持高电平至少为30ns (图10 ,T
14
)
把它背LOW为后续的读取之前的COM
命令。
转换开始后12.5时钟周期(BUSY
变低),则新的数据被锁存到它的输出寄存器。
如果约12.5个时钟周期后开始读处理
忙跑到低, RD和CS应保持低电平至少
为50ns ,以获取新的数据存储到寄存器和开关
到输出端。
CS为低电平告诉ADS7864是主板上的总线
被分配给ADS7864 。如果A / D转换器共享总线
数字门电路,存在这样的可能性,即数字(高
频率)的噪声被耦合到A / D转换器。如果
公交车是刚刚使用的ADS7864 , CS可以用硬连线来
地面上。读数据在保持之一的下降沿
信号可能会导致保持值的失真。
输出代码( DB15 ...... DB0 )
该ADS7864有一个16位输出字。 DB15为1,如果
输出包含有效的数据。这是为FIFO重要
模式。有效的数据可以读取,直到DB15切换为0 。
DB14 , DB13和DB12专卖店渠道的信息indi-
符在表一(通道真值表) 。 12位输出
数据从DB11 (MSB)至DB0存储(LSB)。
数据通道
A0
A1
B0
B1
C0
C1
DB14
0
0
0
0
1
1
DB13
0
0
1
1
0
0
DB12
0
1
0
1
0
1
表一通道真值表。
BYTE ,如果
仅存在一个8位的总线上提供一个板
然后字节可设置高(见图11和12)。在这
情况下,低8位可被读取,输出引脚DB7
至DB0在第一RD信号和之后的较高位
第二个RD信号。
获取数据
该ADS7864有三种不同的输出模式,即
与A2 , A1和A0选择。
与( A2 A1 A0 )= 000〜 101的特定CAN通道
直接寻址(见表II和图9)。该
通道地址应设置至少为10ns (图10 ,T
12
)
RD的下降沿之前,不应该改变,只要
作为RD低。
SELECTED CHANNEL /
模式
A0
A1
B0
B1
C0
C1
循环模式
FIFO模式
A2
0
0
0
0
1
1
1
1
A1
0
0
1
1
0
0
1
1
A0
0
1
0
1
0
1
0
1
表II 。地址/模式真值表。
时钟
HOLDB
t
4
t
1
CS
t
13
RD
t
14
t
12
A0
图10.时序读取数据。
®
ADS7864
12
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