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CY2304SI-1T 3.3V零延迟缓冲器 (3.3V Zero Delay Buffer)
.型号:   CY2304SI-1T
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描述: 3.3V零延迟缓冲器
3.3V Zero Delay Buffer
文件大小 :   269 K    
页数 : 9 页
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品牌   CYPRESS [ CYPRESS SEMICONDUCTOR ]
购买 :   
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PDF原版 中文翻译版  
100%
CY2304
3.3V零延迟缓冲器
特点
零输入输出传输延迟,可调电容
负载FBK输入
多种配置
多个低抖动输出
10 MHz至133 MHz的工作范围
90 ps的典型峰值周期到周期抖动为15 pF的, 66兆赫
节省空间的8引脚150密耳SOIC封装
3.3V操作
提供工业级温度
需要被驱动到FBK销,并且可以从得到的
一个输出。的输入 - 输出偏移被保证是
小于250 ps的,并输出至输出歪斜保证是
超过200 ps的少。
该CY2304有每两个输出两个银行。
该CY2304 PLL进入省电状态,当没有
在REF输入的上升沿。在这种模式下,所有的输出都
三态并且PLL被关断,从而导致在小于
25
μA
的电流消耗。
多个CY2304设备能够接受相同的输入时钟和
在一个系统中分发。在这种情况下,之间的歪斜
的两个设备输出被保证是小于500 ps的。
该CY2304是在两种不同的配置,如
所示
其中输出频率等于参考,如果没有
计数器中的反馈路径。
该CY2304-2允许用户获得价和1 /2倍或2倍
频率上的每个输出库。的确切配置和
输出频率取决于其输出驱动反馈
引脚。
功能说明
该CY2304是设计用来分发3.3V零延迟缓冲器
在高速时钟PC ,工作站,数据通信,电信,和
其它高性能应用。
该部分具有一个片上的锁相环(PLL),用于锁定到一个
输入时钟呈现在REF引脚。该PLL反馈
逻辑框图
FBK
CLKA1
REF
PLL
CLKA2
/2
额外的除法(-2 )
CLKB1
CLKB2
表1.可用配置
设备
CY2304-1
CY2304-2
CY2304-2
FBK从
银行A或B
银行
B组
银行A频率
参考
参考
2 ×参考
B组频率
参考
Reference/2
参考
引脚配置
图1.采用8引脚SOIC - 顶视图
REF
CLKA1
CLKA2
GND
1
2
3
4
8
7
6
5
FBK
V
DD
CLKB2
CLKB1
赛普拉斯半导体公司
文件编号: 38-07247牧师* ˚F
198冠军苑
圣荷西
,
CA 95134-1709
408-943-2600
修订后的2009年3月12日
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