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CY2309CZXI-1T 3.3V零延迟时钟缓冲器 (3.3V Zero Delay Clock Buffer)
.型号:   CY2309CZXI-1T
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描述: 3.3V零延迟时钟缓冲器
3.3V Zero Delay Clock Buffer
文件大小 :   309 K    
页数 : 14 页
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品牌   CYPRESS [ CYPRESS SEMICONDUCTOR ]
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100%
初步
CY2305C
CY2309C
3.3V零延迟时钟缓冲器
特点
10 MHz至100-133 MHz的工作范围内,与CPU的兼容
和PCI总线频率
零输入和输出的传播延迟
多个低输出偏斜
一个输入驱动五个输出( CY2305C )
一个输入驱动器9输出,归纳为4 + 4 + 1 ( CY2309C )
50 ps的典型的循环周期抖动( 15 PF, 66兆赫)
测试模式到旁路相位锁定回路(PLL )( CY2309C )仅
SEE
提供节省空间的16引脚1.5亿SOIC或4.4毫米
TSSOP封装( CY2309C ) ,以及8引脚, 1.5亿SOIC
包( CY2305C )
3.3V操作
提供工业级温度
CY2309C 。它接受一个参考输入,驱动了5次低
歪斜的时钟。每个器件的-1H版本操作达
100-133 MHz的频率和有动力比越高-1
设备。所有部件具有片上PLL的哪个锁定到输入时钟
REF引脚。 PLL反馈是在芯片上,并获得
从CLKOUT垫。
该CY2309C有各自的四个输出两个银行
通过选择输入端的控制,如图中的
需要BankB处于三态。输入时钟是直接
由选择输入,用于芯片和系统应用到输出
测试目的。
该CY2305C和CY2309C的PLL进入掉电模式
当有对REF输入没有上升沿。在这种状态下,
的输出三态并且PLL被关断。这
结果在小于12.0
μA
电流消耗为商业的
温装置和25.0
μA
工业温度
件。该CY2309C PLL在一个额外的情况下关闭
在所示的
在特殊情况下,当S2: S1为1:0 , PLL被旁路和
REF为从DC输出到所允许的最大频率。该
部的行为就像在此模式中的非零延迟缓冲器和
输出没有三态。
该CY2305C或CY2309C有两个或三个不同的
构如图中
CY2305-1H或CY2309-1H是-1的高驱动版本。其
上升和下降时间比-1的速度要快得多。
功能说明
该CY2305C和CY2309C是模具更换部件
CY2305和CY2309 。
该CY2309C是设计成一种低成本3.3V零延迟缓冲器
分配高速时钟,并采用16引脚SOIC或
TSSOP封装。该CY2305C是的8引脚版本
逻辑框图CY2309C
PLL
REF
MUX
CLKOUT
CLKA1
CLKA2
CLKA3
CLKA4
CLKB1
选择输入
解码
S1
CLKB2
CLKB3
CLKB4
S2
赛普拉斯半导体公司
文件编号: 38-07672牧师* ˚F
198冠军苑
圣荷西
,
CA 95134-1709
408-943-2600
修订后的2007年7月5日
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