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CY2SSTV857ZXI-27T 差分时钟缓冲器/驱动器DDR333 / PC2700兼容 (Differential Clock Buffer/Driver DDR333/PC2700-Compliant)
.型号:   CY2SSTV857ZXI-27T
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描述: 差分时钟缓冲器/驱动器DDR333 / PC2700兼容
Differential Clock Buffer/Driver DDR333/PC2700-Compliant
文件大小 :   151 K    
页数 : 9 页
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品牌   CYPRESS [ CYPRESS SEMICONDUCTOR ]
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100%
CY2SSTV857-27
绝对最大条件
[2]
输入相对于V电压
SS
:...............................V
SS
– 0.3V
输入相对于V电压
DDQ
或AV
DD
: ........... V
DDQ
+ 0.3V
存储温度: ................................ -65° C至+ 150°C
工作温度: .................................... 0 ° C至+ 85°C
最大电源: .............................................. ..3.5V
该器件包含电路,以保护输入对
损坏,由于高静电压或电场;不过,
应采取预防措施,以避免应用程序的任何
电压大于最大额定电压至该电路更高。
为了正常工作,V
in
和V
OUT
应限制到
范围:
V
SS
& LT ; (V
in
或V
OUT
) & LT ; V
DDQ
.
未使用的输入必须始终连接到一个适当的逻辑
电压电平(或V
SS
或V
DDQ
).
DC电气规格
( AV
DD
= V
DDQ
= 2.5V ±5% ,T
A
= 0°C至+ 85°C )
[3]
参数
V
DDQ
V
IL
V
IH
V
ID
V
IX
I
IN
I
OL
I
OH
V
OL
V
OH
V
OUT
V
OC
I
OZ
I
DDQ
I
DD
I
DDS
CIN
描述
电源电压
输入低电压
输入高电压
差分输入电压
[4]
差分输入隧道
电压
[5]
输出低电流
输出高电流
输出低电压
输出高电压
输出电压
摇摆
[6]
电压
[7]
所有V
DDQ
, F
O
= 170兆赫
V
DDA
PD # = 0和CLK / CLK # < 10兆赫
输出隧道
CLK , FBIN
CLK , FBIN
操作
PD #
0.7 × V
DDQ
0.36
V
DDQ
+ 0.3
(V
DDQ
/2) – 0.2 V
DDQ
/2 (V
DDQ
/2) + 0.2
–10
26
–28
1.7
1.1
–10
235
9
V
DDQ
– 0.4
10
300
12
100
4
(V
DDQ
/2) – 0.2 V
DDQ
/2 (V
DDQ
/2) + 0.2
35
–32
0.6
10
条件
分钟。
2.38
典型值。
2.5
马克斯。
2.63
0.3 × V
DDQ
单位
V
V
V
V
V
µA
mA
mA
V
V
V
V
µA
mA
mA
µA
pF
输入电流[ CLK , FBIN , PD # ] V
IN
= 0V或V
IN
= V
DDQ
V
DDQ
= 2.375V, V
OUT
= 1.2V
V
DDQ
= 2.375V, V
OUT
= 1V
V
DDQ
= 2.375V ,我
OL
= 12毫安
V
DDQ
= 2.375V ,我
OH
= -12毫安
高阻抗输出电流V
O
= GND或V
O
= V
DDQ
动态电源电流
[8]
PLL电源电流
待机电源电流
输入引脚电容
AC电气规格
( AV
DD
= V
DDQ
= 2.5V ±5% ,T
A
= 0°C至+ 85°C )
[9, 10]
参数
f
CLK
t
DC
t
LOCK
D
TYC
谢瑞麟( O)
t
PZL
, t
PZH
描述
工作时钟频率
输入时钟的占空比
最大PLL锁定时间
占空比
[11]
时钟输出摆率
输出使能时间
[12]
条件
AV
DD
, V
DDQ
= 2.5V
±
0.2V
分钟。
60
40
典型值。
马克斯。
200
60
100
单位
兆赫
%
µs
%
%
V / ns的
ns
60兆赫至100兆赫
101 MHz至170 MHz的
视频点播的20%-80%
(所有输出)
49.5
49
1
50
50.5
51
2
3
25
注意事项:
2.
多个电源:
对任何输入或I / O引脚上的电压不能超过电期间的电源引脚。电源排序不是必需的。
3.未使用的输入必须保持高电平或低电平,以防止它们飘浮。
4.差分输入信号电压指定的差分电压切换所需要的,在这里的VTR是实际的输入电平的VTR - VCPI和VCP是互补
输入电平。看
图6 。
5.差分交叉点输入电压预计追踪V
DDQ
并且是在该差分信号必须穿越的电压。
6.对于负载条件参见
图6 。
7. V的值
OC
预计是( VTR + VCP )/ 2。如果每个时钟的直接终止一个120Ω的电阻。看
图6 。
8.所有输出开关负载14 pF的在60Ω环境。看
图6 。
9.参数由设计和特性保证。不是100 %生产测试。
10. PLL能够满足指定的参数,同时支持合成SSC采用30kHz和50 kHz的调制频率有下降的
传播或-0.5 % 。
11.虽然脉冲偏移是在频率几乎恒定,占空比误差在较高的频率增加。这是由于下式:占空比=吨
世界遗产
/t
C
,
其中,循环时间(t
C
)随着频率上升。
12.指非反相输出的过渡。
文件编号: 38-07464牧师* G
第6 9
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