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ADM4210-2AUJZ-RL7  ADM3491ARZ-REEL  ADM3488E  ADM483  ADM483AR  ADM3490EARZ  ADM3488EARZ-REEL7  ADM3486EARZ-REEL7  ADM483AR  SK15BGD065ET  
MPC8548EVUAQH 的PowerQUICC ™III集成处理器硬件规格 (PowerQUICC™ III Integrated Processor Hardware Specifications)
.型号:   MPC8548EVUAQH
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描述: 的PowerQUICC ™III集成处理器硬件规格
PowerQUICC™ III Integrated Processor Hardware Specifications
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页数 : 144 页
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品牌   FREESCALE [ FREESCALE SEMICONDUCTOR, INC ]
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100%
高速串行接口( HSSI )
在133 MHz的表50. PCI -X AC时序规范(续)
参数
HRESET到PCI -X初始化模式保持时间
符号
t
PCRHIX
0
最大
50
单位
ns
笔记
6, 12
注意事项:
1.请参见时序测量条件的
PCI -X 1.0a规范。
2.最小时间是在封装引脚(未测试点)进行测定。最大时间测量与测试点
负载电路。
为点至点的信号3.建立时间适用于REQ和GNT只。所有其他信号汇流排。
4.为了主动/浮定时测量的,为Hi-Z或关闭状态被定义为当总电流输送
通过该组件引脚小于或等于所述漏电流规格。
5.建立时间只适用于当装置不驱动销。设备不能驱动信号和接收信号在同一时间。
6.最大的值还受到延迟的第一个事务(时间HRESET高至第一配置访问,叔
PCRHFV
).
后HRESET的上升沿的PCI-X的初始化模式的控制信号必须被购买否定不大于两个时钟
在第一帧之前,必须浮不迟于一个时钟前FRAME断言。
7. PCI - X设备被允许显示在t的最小值
PCKHOV
和T
CYC
仅在PCI-X模式。在传统的
模式,则该设备必须满足PCI 2.2的合适的时钟频率的要求。
8.设备必须符合本规范独立的多输出如何同时切换。
9.时序参数t
PCIVKH
为最小的1.4纳秒,而不是1.2纳秒的最低
PCI -X 1.0a规范。
10.时序参数t
PCRHFV
是最小的10个时钟周期,而不是5个时钟周期中的最小
PCI -X 1.0A
特定连接的阳离子。
经鉴定11.Guaranteed 。
设计11.Guaranteed 。
15高速串行接口( HSSI )
该MPC8548E设有用于高速串行1串行器/解串器( SerDes的)接口
互连应用。在SERDES接口,可用于PCI Express和/或串行RapidIO数据
接送。
本节介绍的串行解串器的直流电气规范的公共部分,这是DC
要求的SerDes参考时钟。在SERDES数据通道的发送器和接收器的参考电路
还示出。
15.1
信号术语定义
该串行解串器采用差分信号,以通过串行链路上传输的数据。本节定义条款
在差分信号的描述和说明书中使用。
显示了信号被限定。为了说明的目的,只有一个SerDes通道用于
说明。该图显示了一个波形为任一发射机的输出( SD_TX和SD_TX )或
接收器输入端( SD_RX和SD_RX ) 。一伏, B伏之间的每个信号摆幅,其中A > B.
MPC8548E的PowerQUICC ™III集成处理器的硬件规格,版本6
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