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BUS-61559-870S  S29CD016G0MFAI212  S29CD016G0MFAI012  BUS-61559-860Y  BUS-61559-840Q  BUS-61559-830L  BUS-61559-890Z  BUS-61559-870  S29CD016G0MFAM102  BUS-61559-840S  
IDT72T3665L6BBI 2.5伏高速TeraSyncTM FIFO的36位配置 (2.5 VOLT HIGH-SPEED TeraSyncTM FIFO 36-BIT CONFIGURATIONS)
.型号:   IDT72T3665L6BBI
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描述: 2.5伏高速TeraSyncTM FIFO的36位配置
2.5 VOLT HIGH-SPEED TeraSyncTM FIFO 36-BIT CONFIGURATIONS
文件大小 :   550 K    
页数 : 57 页
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品牌   IDT [ INTEGRATED DEVICE TECHNOLOGY ]
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100%
IDT72T3645 / 55 /65 /八十五分之七十五/一百〇五分之九十五/一百二十五分之一百一十五2.5V TeraSync 36位的FIFO
1K ×36 , 2K ×36 , 4K ×36 , 8K ×36 , 16K ×36 , 32K ×36 , 64K ×36 , 128K ×36和256K ×36
商业和工业
温度范围
描述(续)
该器件包括从马克的功能,利用两个控制重传
输入,马克和,
RT
(重发) 。如果标记的输入使能尊重
到RCLK ,存储器位置被读取该点处将被标记。任何
随后的重传操作,
RT
变为低电平,复位读指针
这个“标”的位置。
该设备可以具有不同的输入和输出的总线宽度为被构造
在表1中示出。
提供大端/小端数据字格式。这个功能是
有用的,当数据被写入到长字格式( X36 / X18 )的FIFO和读
在小词( ×18 / ×9 )格式,在FIFO中。如果选择大端模式,
那么长字的写入FIFO中最显著字节(字)将
被从FIFO读出第一个,随后在至少显著字节。如果小端
格式被选择时,则长字的最低显著字节写入到
FIFO将被首先读出,随后是最显著字节。该模式所需
在主复位由大端( BE )引脚的状态配置。看
图5为
总线匹配字节安排。
穿插/非穿插奇偶校验( IP )位功能允许用户
选择在加载到并行端口的字中的奇偶校验位(四
0
-dn )时,
编程标志偏移。如果选择穿插平价模式,则
FIFO将假设奇偶校验位位于位位置D8 , D17 , D26和
标志偏移的并行编程期间D35 。如果不穿插
奇偶校验模式被选择,那么D8 , D17和D26被假定为有效的位
和D32 , D33 , D34和D35被忽略。 IP模式硕士期间选择
由IP输入引脚的状态复位。
如果,在任何时间,在FIFO没有积极地执行一个操作,该芯片将
自动关机。一旦在断电状态下,待机电源
电流消耗最小化。启动任何操作(通过激活控制
输入)将立即停止设备的的掉电状态。
这两个异步输出使能引脚( OE )和同步阅读
设置在所述FIFO中的芯片选择引脚(RCS) 。同步读片
选择同步到RCLK 。同时输出使能和读芯片选择
控制FIFO的输出缓冲器,使缓冲器为任一高
阻抗和低阻抗。
提供一个JTAG测试端口,这里的FIFO有功能齐全的边界
扫描功能,符合IEEE 1449.1标准测试访问端口和
边界扫描结构。
该TeraSync FIFO有工作在它的端口的能力(写入和/或
读)在任一LVTTL或HSTL模式下,每个端口选择独立的
等。写端口选择通过WHSTL和读取端口选择做
通过RHSTL 。还提供了一个附加的输入SHSTL ,这使得用户
选择设备(未与相关的其他引脚HSTL操作
写或读端口) 。
该IDT72T3645 / 72T3655 / 72T3665 / 72T3675 / 72T3685 / 72T3695 /
72T36105 / 72T36115 / 72T36125采用IDT的高速子是捏造
微米CMOS技术。
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