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LSWM-453232-R15M-T  LSWM-453232-100K-T  LSWM-453232-2R7J-T  MAX1247AEPE  LSWM-453232-R15M-B  MAX1247ACEE  LSWM-453232-8R2M-T  LSWM-453232-2R2K-B  LSWM-453232-1R8M-T  LSWM-453232-8R2K-B  
IDT72V73260DA 3.3伏时隙交换数字开关16,384 X 16,384 (3.3 VOLT TIME SLOT INTERCHANGE DIGITAL SWITCH 16,384 X 16,384)
.型号:   IDT72V73260DA
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描述: 3.3伏时隙交换数字开关16,384 X 16,384
3.3 VOLT TIME SLOT INTERCHANGE DIGITAL SWITCH 16,384 X 16,384
文件大小 :   190 K    
页数 : 26 页
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品牌   IDT [ INTEGRATED DEVICE TECHNOLOGY ]
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100%
IDT72V73260 3.3V时隙交换
数字开关16,384 X 16,384
工业温度范围
引脚说明
符号
名字
A0-15
地址0 〜15
C32i
CS
D0-15
DS
DTA
时钟
芯片选择
数据总线0-15
数据选通
数据传输
承认
评估框架
I / O
描述
我这些地址线访问所有内部存储器。
I
I
串行时钟输入/移出数据的串行数据流。这个输入接受一个32.768 MHz的时钟。
这个低电平有效输入由一个微处理器来激活IDT72V73260的微处理器接口。
I / O这些引脚微处理器端口的数据位。
我该低电平有效的输入工作结合
CS
以使读和写操作,并设置
数据总线( D0 - D15 ) 。
O
指示的数据总线传输完成。当总线周期结束时,该引脚驱动为高电平,然后去
高阻抗,从而允许更快的总线周期,一个弱上拉电阻。一个上拉电阻器是必需的
保持高电平时,引脚处于高阻抗。
此输入可用于通过比较帧脉冲, F32i ,与该输入来测量延迟数据路径中。
FE
I
F32i
GND
ODE
帧脉冲
输出驱动器启用
I
根据这个输入接受并自动识别帧同步信号格式
ST- BUS
®
GCI和规格。
地轨
这是在输出使能控制对TX串行输出。当ODE投入低,产出站
通过对控制寄存器位为低电平时,所有的TX输出处于高阻抗状态。如果该输入是HIGH时,将TX
输出驱动器被启用。但是,每个信道仍然可以置于高阻抗状态,通过使用
每信道的控制位在连接存储器。
该输入放IDT72V73260成清除设备内部计数器,寄存器和复位状态
带来TX0-31和D0 - D15为高阻抗状态。该
RESET
引脚必须保持为低电平最低
为20ns的正确重置设备。
此输入控制过程中的微处理器存取的数据总线(D0 -D15 )的方向。
串行数据的输入流。这些物流有32.768Mb / s的数据速率。
提供时钟的JTAG测试逻辑。
JTAG串行测试指令和数据都在这个引脚移入。该引脚拉高由内部上拉
如果没有驱动。
JTAG串行数据从该引脚在TCK的下降沿输出。该引脚为高阻抗状态保持
当JTAG扫描未启用。
JTAG信号控制所述TAP控制器的状态转换。该引脚拉高由内部
拉时不被驱动。
异步通过将其在测试逻辑复位状态初始化JTAG TAP控制器。该引脚
如果没有驱动由内部上拉拉。该引脚应低脉冲上电,或保持低电平,
以确保IDT72V73260是在正常功能模式。
串行数据输出流。这些物流有32.768Mb / s的数据速率。
当所有32个输出流是通过控制寄存器选择,这些引脚的输出流TX16以TX31
与运行在32.768Mb /秒。当输出使能功能被选择时,这些引脚反映的活性或
为相应的输出流输出高阻抗状态启用Indication0-15 。
+3.3伏电源。
I
RESET
器件复位
I
读/写
RX0-31
TCK
TDI
TDO
TMS
TRST
读/写
数据流
输入0至31
测试时钟
测试串行数据
测试串行数据输出
测试模式选择
测试复位
I
I
I
I
O
I
I
TX0-15
TX输出0到15
(三态输出)
O
O
TX16-31 / TX输出16〜 31 /
OEI0-15输出使能
指示0 〜15
(三态输出)
V
CC
V
CC
4
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