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L630-0UY-028S  VI-BN3-EV  L630-0UR-028W  L630-0UY-120AN  L630-0UY-024M  VI-BN4-IV  CS8905-CL  VI-BN3-CX-S  VI-BN4-CX-S  L630-0UY-036M  
IDT79R3081-33PFM RISController与FPA (RISController with FPA)
.型号:   IDT79R3081-33PFM
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描述: RISController与FPA
RISController with FPA
文件大小 :   297 K    
页数 : 38 页
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品牌   IDT [ INTEGRATED DEVICE TECHNOLOGY ]
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100%
IDT79R3081 RISController
军用和商用温度范围
简单的握手信号, CPU处理读写
请求。除了读操作和写操作的界面, R3051
系列包含了DMA仲裁器,允许外部主机
控制外部总线。
在R3081还支持基于硬件的缓存一致性
在DMA写。在R3081可以指定行无效
数据缓存,或者实际上可以在执行突发失效
爆DMA写道。
在R3081采用了4 -深写缓冲区脱钩
执行引擎的自的速度的速度
存储器系统。写缓冲区捕捉和FIFO处理器
在存储操作的地址和数据信息,和现在
它向总线接口写入事务处的速率的
内存系统可以容纳。
在R3081读取接口进行单数据
读取和四字读。单用一个简单的读取工作
握手,并四字读可以利用简单的
握手(在较低的性能,简单的系统),或利用
当存储系统可以猝发数据更紧的定时模式
在该处理器的时钟速率。因此,系统设计者可以
选择使用页或半字节方式的DRAM (也可能
使用交织,如果需要的话,在高性能系统中) ,或
用更简单的方法来降低复杂性。
为了适应较慢四字读取,该
R3081集成了一个4深读缓冲器FIFO ,以使得
外部接口可以实现在处理器内排队数据
释放它之前执行的内部缓存的突发填充。
在R3081是R3051超在其总线接口兼容。
具体地, R3081具有额外的支撑,以简化
甚高频系统的设计。这种支持包括
到二分之一的处理器上运行的总线接口的能力
执行速率,以及减慢跃迁的能力
之间的读取和写入操作提供额外的缓冲禁用时间
用于存储器接口。然而,它仍然是可能的,设计
一个系统,没有修改的PC板或
软件,可以接受的R3041 , R3051 , R3052 , R3071 ,
或R3081 。
到一个给定的应用中,系统设计工程师可以
包括来自DRAM ,提供真正的高爆支持
性能高速缓存未命中处理,或利用较简单的,
低性能存储系统,以降低成本和简化
设计。类似地,系统设计者可以选择
实现诸如外部二级缓存技术,或
(DMA),以进一步提高系统的性能。
开发支持
该IDT R3051系列支持丰富的
开发工具,从系统仿真工具
通过PROM监控和调试支持,应用程序
软件和实用程序库,逻辑分析工具,子系统
模块和收缩包装的操作系统。在R3081 ,
这是引脚和软件与R3051兼容,可以
直接利用这些现有的工具来缩短产品上市时间。
图7是该系统的开发过程的概述
通常开发R3051系列应用程序时使用。
在R3051系列支持项目的所有阶段
发展。这些工具能够及时,并行开发
硬件和软件为R3051的家庭应用中,与
包括工具,如:
•优化的MIPS ,是公认的领导者编译器
在优化编译技术。
•交叉开发工具,在各种可用
开发环境。
• IDT的评估板,包括RAM , EPROM ,
I / O ,以及IDT PROM监视器。
• IDT / SIM
,它实现了一个完整的舞会显示器
(诊断,远程调试支持,PEEK /捅,等) 。
• IDT /套
,它实现了运行时支持包
R3051系列系统。
性能概述
在R3081达到的性能非常高的级别。这
性能是基于:
一个高效的执行引擎。
CPU执行ALU
操作和存储操作在一个周期内,并且具有
的1.3个周期的有效负载时,与分支执行
的1.5个周期率(基于编译器的能力
避免软件互锁) 。因此,执行发动机
运行时实现了超过35 VUPS性能
缓存。
一个全功能的浮点加速器/协处理器。
在R3081集成了一个R3010A兼容浮动
点加速芯片,具有独立的ALU浮动
点加,乘,除法。浮点单元是完全
硬件互锁,和特征的重叠的操作
和精确的例外。在FPA允许浮点
加,乘,并划分与同时发生
彼此,以及同时进行整数运算。
大型片上高速缓存。
在R3051系列包含缓存
它们基本上比那些在多数较大
今天的微处理器。这些大容量高速缓存减少
总线事务的数目必需的,并且允许R3051
家庭实现实际的持续性能非常接近
其峰值执行率。在R3081双打缓存
可在R3052 ,使其成为一个合适的发动机
5
制用法
该IDT R3051系列是专门设计来
允许多种存储系统。低成本系统
可以使用慢速的回忆和简单的控制器,而
其他设计师可能会选择把更高的频率,
更快的记忆,和技术,如DMA实现
最大性能。在R3081包括具体支持
对于高perfromance系统,包括必要的信号
实施外部二级缓存,并能够
在多主机执行基于硬件的缓存一致性
系统。
图6示出一个典型的系统实现。
透明锁存器被用于解复用的R3081
地址和数据总线从所述A / D总线。数据路径
存储器系统元件和A / D转换总线之间是
通过简单的八进制的设备管理。小组简单的PAL
用于控制各种数据路径元素,并且向
控制所述存储器器件和之间的握手
中央处理器。
根据成本与性能的权衡适当
5.5
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