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PSD854F5A-12U  PSD854F5A-12UIT  PSD854F5-70JT  CY7C1366A-200BGC  PSD854F5-70JI  PSD854F5A-12M  PSD854F5-90J  PSD854F5-70MT  PSD854F5A-20J  CY7C1366A-150BGC  
X5168S8Z CPU监控与16Kbit的EEPROM SPI (CPU Supervisor with 16Kbit SPI EEPROM)
.型号:   X5168S8Z
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描述: CPU监控与16Kbit的EEPROM SPI
CPU Supervisor with 16Kbit SPI EEPROM
文件大小 :   343 K    
页数 : 20 页
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品牌   INTERSIL [ INTERSIL CORPORATION ]
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100%
X5168, X5169
阅读顺序
从EEPROM存储器阵列读取数据时, CS为网络RST
拉低来选择设备。 8位READ指令
发送到设备,随后是16位地址。
后读的操作码和地址发送,所述数据
存储在所选择的地址的存储器数据被移出
在SO线上。在下一存储在存储器中的数据
地址可以按顺序通过连续提供读取
时钟脉冲。地址会自动递增到
每个数据字节后下一个较高地址被移出。
当最高地址为止,地址计数器
翻转处理0000美元允许读周期是
继续下去。在读操作被终止
以CS为高电平。请参阅读取EEPROM阵列序列
(图1) 。
读状态寄存器, CS线首先拉低
选择该设备随后的8位RDSR指令。
后RDSR操作码发送的状态的内容
寄存器的SO线移出的。参考读出的状态
寄存器序列(图2) 。
操作说明
该器件通电时处于以下状态:
- 该设备处于低功耗待机状态。
- 对CS高向低过渡需要输入
活动状态和接收指令。
- SO引脚为高阻抗。
- 写使能锁存器复位。
- 该标志位被复位。
- RESET信号是活跃吨
PURST
.
数据保护
下面的电路已被包括在内,以防止
意外写入:
•一个WREN指令必须发出来设置写使能
锁存器。
• CS要来得高,在适当的时钟,以数到
启动一个非易失性写周期。
写序
之前的任何企图将数据写入到器件中, “写
启用“锁存器( WEL)必须首先通过发出WREN设置
指令(图3) 。 CS是第一次被拉低,那么雷恩
指令被发送到器件。之后所有8位的
指令传输, CS必须被拉高。如果
用户继续写入操作,而不考虑连拍
发出WREN指令后高,写操作
将被忽略。
将数据写入EEPROM存储器阵列中,用户然后
发出写指令,然后利用16位地址
然后将要写入的数据。任何未使用的地址位
指定为“ 0” 。写操作微创取
32个时钟周期。 CS必须变为低电平,并保持低电平的持续时间
的操作。如果地址计数器到达的结束
页面和时钟继续,计数器将回滚到
页面的第一个地址,并覆盖任何数据可
已被预先写入。
对于页写操作(字节或页写)是
完成后, CS只能在高位的0后带来的
最后一个数据字节写入的时钟频率。如果它被拉高
在其他任何时间,写操作将不会完成
(图4) 。
写状态寄存器, WRSR指令是
接着要写入的数据(图5) 。数据位0,
1必须为“0”。
而写入过程中下一个状态寄存器或
EEPROM的序列时,状态寄存器可以读出到
检查WIP位。在此期间, WIP位会很高。
9
FN8130.2
2006年6月15日
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