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5962H9475401VYA  5962H9475406VLA  5962H9475402QLC  5962H9475401V3X  5962H9475401VLC  5962H9475402QKX  5962H9475404QYC  5962H9475402Q3X  5962H9475404VYC  5962H9322604VZA  
MAX1419 15位,支持65Msps ADC与基带应用-79.3dBFS本底噪声 (15-Bit, 65Msps ADC with -79.3dBFS Noise Floor for Baseband Applications)
.型号:   MAX1419
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描述: 15位,支持65Msps ADC与基带应用-79.3dBFS本底噪声
15-Bit, 65Msps ADC with -79.3dBFS Noise Floor for Baseband Applications
文件大小 :   330 K    
页数 : 18 页
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品牌   MAXIM [ MAXIM INTEGRATED PRODUCTS ]
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100%
15位,支持65Msps ADC,具有-79.3dBFS
在基带应用本底噪声
详细说明
图1提供了MAX1419架构设计师用手工的概述
tecture 。在MAX1419采用输入T / H放大器,
它已被优化为低热噪声和
低失真。高阻抗差分输入
该T / H放大器( INP和INN )的自偏置
3.38V ,并支持满量程差分输入电压
2.56V的
P-P
。该T / H放大器的输出被馈送到
多级流水线ADC的核心,这也一直
优化,以达到一个非常低的热噪声本底和
低失真。
时钟缓冲器接收差分输入时钟波形
形成和产生低抖动时钟信号,用于将输入
T / H 。在模拟输入信号进行采样,在
差分时钟波形的上升沿。在昼夜温差
髓鞘时钟输入( CLKP和CLKN )是高
阻抗输入,是自偏置电压为2.4V ,并支持
从0.5V差分时钟波形
P-P
至3.0V
P-P
.
从多级流水线ADC核心的输出
被传递到纠错和格式化逻辑电
进而,提供了15位的输出代码中two's-
补充格式为数字输出驱动器。输出
驱动器提供CMOS兼容电平输出
可编程的过一个2.3V至3.5V范围内。
INP
MAX1419
AV
CC
GND
DV
CC
DRV
CC
MAX1419
客栈
CM
国内
参考
T / H
多级
流水线ADC核心
CLKP
时钟
卜FF器
CLKN
国内
定时
更正
LOGIC +输出
缓冲器
15
DAV
数据位D0到D14
科幻gure
1. MAX1419简化框图
T / H放大器
INP
1。 QUANTIZER阶段
500Ω
卜FF器
1kΩ
CM
内部参考
和偏置​​电路
模拟输入和
共模( INP , INN , CM )
信号输入到MAX1419 ( INP和INN )是
平衡差分输入。这种差异的配置
化提供了抗共模噪声耦合
和拒绝的偶次谐波项。存在差
无穷区间信号输入到MAX1419应该是交流耦
PLED和,以达到最佳的小心平衡
动态性能(见
应用信息
部分以了解详情) 。输入信号的交流耦合
是很容易实现的,因为MAX1419的输入
如示于图2中虽然自偏压
T / H输入是高阻抗,实际差
输入阻抗是因为两个名义上1kΩ的
从每个输入端连接到500Ω偏置电阻
共模基准。
500Ω
客栈
T / H放大器
1。 QUANTIZER阶段
科幻gure
2.简化的模拟和共模输入架构
在CM引脚提供输入的监测共
模式自偏置电位。在大多数应用中,在其中
输入信号为交流耦合,该引脚不连接 -
ED 。如果需要,输入信号的直流耦合,这
销可被用来构造一个直流伺服环路CON组
控制输入共模电压。见
应用信息
更多的细节部分。
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