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GSIB1540N  GSIB1580N  GSG3809X  GSIB1560N  GSIB1520N  GSG3801C  
MPC9772 3.3V LVCMOS 1:12 PLL时钟发生器 (3.3V 1:12 LVCMOS PLL Clock Generator)
.型号:   MPC9772
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描述: 3.3V LVCMOS 1:12 PLL时钟发生器
3.3V 1:12 LVCMOS PLL Clock Generator
文件大小 :   239 K    
页数 : 16 页
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品牌   MOTOROLA [ MOTOROLA, INC ]
购买 :   
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摩托罗拉
半导体技术资料
订单号: MPC9772
REV 3 , 05/2004
3.3V LVCMOS 1:12 PLL时钟
发电机
该MPC9772是3.3V兼容, 1:12基于PLL时钟发生器
针对中档高性能低偏移时钟分配
高性能的网络,计算和电信应用。同
输出频率高达240 MHz ,输出偏斜小于250 PS的
器件满足最苛刻的时钟应用的需求。
特点
1:12基于PLL的低电压时钟发生器
3.3V电源
内部上电复位
产生时钟信号高达240 MHz
250 ps的最大输出偏移
片上晶体振荡器的时钟基准
两个LVCMOS PLL的参考时钟输入
外部PLL反馈支持零延迟功能
各种反馈和输出分频器(见应用部分)
最多支持三个生成单独的输出时钟频率
同步输出时钟停止电路为每个输出的
掉电支持
可驱动多达24时钟线
环境温度范围
40 ° C至+ 85°C
引脚和功能兼容的MPC972
MPC9772
3.3V LVCMOS 1点12分
PLL时钟发生器
FA后缀
52引脚LQFP封装
CASE 848D
功能说明
在MPC9772采用PLL技术,频率锁定其输出到输入参考时钟。正常运行
MPC9772需要PLL反馈输出QFB的反馈输入FB_IN的连接,关闭PLL反馈路径。该
参考时钟频率和分频器,用于反馈路径确定VCO频率。两者必须被选择,以匹配
VCO的频率范围。的MPC9772设有12个输出之间的频率的可编程性进行了广泛的水平以及
输出到输入的关系,例如1 :1,2 :1,3 :1,3 :2,4 :1,4 :3,5 : 1,5 : 2,5 :3,5 : 4,5 : 6,6 : 1,8 :1和8:3 。
该QSYNC输出将指示何时发生了上述关系的重合上升边缘。该馈的可选择性
背面频率是独立的输出频率。这允许输入参考与输出的非常灵活的编程
把频率的关系。输出频率可以是输入参考的奇数或偶数倍。此外,输出
频率可以小于输入频率的应用中的频率需要由非二进制因子被减小。该
MPC9772也支持其输出银行之一相对于另一个输出银行的180°相移。该QSYNC输出
反映了QA和QC输出之间的相位关系,并可以用于系统的基准定时信号的产生。
该REF_SEL引脚选择内部晶振或LVCMOS兼容的输入作为参考时钟信号。两个替代方案
提供时钟冗余支持原生兼容LVCMOS时钟输入。该PLL_EN控制选择PLL旁路CON-
成形用于测试和诊断。在这种结构中,所选择的输入参考时钟被直接路由到输出分频器
绕过PLL 。该PLL旁路是完全静态的,最低时钟频率规格和其他所有的PLL特性做
不适用。
该输出可以单独禁用(在逻辑低状态停止)通过编程的串行接口CLOCK_STOP
MPC9772 。该MPC9772具有内部上电复位。
该MPC9772是完全3.3V兼容,无需外部环路滤波器元件。所有输入( XTAL除外)接受LVCMOS
而输出提供LVCMOS兼容水平与能力的信号,以驱动终止50
传输线。对于系列
端接的传输线,每条的MPC9772输出能够驱动一个或两个迹线给出的装置的1点24的有效的扇出。
该器件的引脚和功能兼容的MPC972和封装在一个52引脚LQFP封装。
©摩托罗拉公司2004年
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