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2-1393215-5  2-1393215-7  PE300001  LBSTCM-1-D  2-1393215-3  LTSHRE-1-S  2-1393132-5  2-1393137-0  PE300006  2-1393136-9  
FM25CL64B-G 64Kb的串行3V F-RAM存储器 (64Kb Serial 3V F-RAM Memory)
.型号:   FM25CL64B-G
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描述: 64Kb的串行3V F-RAM存储器
64Kb Serial 3V F-RAM Memory
文件大小 :   302 K    
页数 : 14 页
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品牌   RAMTRON [ RAMTRON INTERNATIONAL CORPORATION ]
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100%
FM25CL64B - 64Kb的3V SPI F-RAM
WP
CS
HOLD
SCK
指令译码
时钟发生器
控制逻辑
写保护
1,024 x 64
FRAM阵列
指令寄存器
地址寄存器
计数器
SI
13
8
数据I / O寄存器
3
非易失性状态
注册
SO
图1.框图
引脚说明
引脚名称
/ CS
I / O
输入
描述
片选:此低电平输入激活的设备。当高,器件进入
低功耗待机模式,忽略了其他的投入,以及所有输出三态。当
低电平时,器件内部激活SCK信号。在/ CS的下降沿必须发生
之前,每个操作码。
串行时钟:所有的I / O活动的同步串行时钟。输入锁存
在下降沿的上升沿和输出发生。由于该设备是静止的,则
时钟频率可以是0和20 MHz之间的任何值,并且可以在被中断
任何时间。
持有:在/ HOLD引脚用于当主机CPU必须中断存储操作
另一项任务。当/ HOLD为低电平,当前操作被暂停。该装置
忽略在SCK或/ CS任何过渡。上/ HOLD所有过渡必须发生在
SCK为低。
写保护:此低电平有效防止脚写操作状态寄存器。
因为其他的写保护功能是通过控制状态,这是关键
注册。设置在第6页& 7写保护的完整解释。
串行输入:所有的数据输入到该引脚上的设备。该引脚被采样到
上升SCK的边缘,在其他时间被忽略。它应该总是​​被驱动为有效的
逻辑电平,以满足国际直拨规格。
* SI可以被连接到的SO为单个引脚的数据接口。
串行输出:这是数据输出引脚。在读它的驱动并保持三
在其他时间,包括时/ HOLD低说明。数据转换是在驱动
串行时钟的下降沿。
* SO可以被连接到的SI为单个引脚的数据接口。
电源( 2.7V至3.65V )
SCK
输入
/ HOLD
输入
/ WP
SI
输入
输入
SO
产量
VDD
VSS
供应
供应
修订版1.2
2011年2月
第14页2
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