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BU9882-W EDID存储器(显示) (EDID Memory (For display))
.型号:   BU9882-W
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描述: EDID存储器(显示)
EDID Memory (For display)
文件大小 :   653 K    
页数 : 23 页
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品牌   ROHM [ ROHM ]
购买 :   
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100%
BR24C21,BR24C21F,BR24C21FJ,BR24C21FV,
BU9882-W,BU9882F-W,BU9882FV-W
同步数据时序
t
R
SCL
t
F
t
技术说明
SCL
t
HD
: STA
SDA
(中)
t
BUF
SDA
(下)
t
PD
t
SU
: DAT
t
t
HD
: DAT
t
SU
: STA
SDA
t
HD
: STA
t
SU
: STO
开始位
停止位
图17同步定时数据
SDA数据在SCL时钟的上升沿锁存到芯片。
输出切换日期在SCL时钟的下降沿。
写周期时序
SCL
SDA
D0
写数据(N )
确认
t
WR
停止条件
启动条件
图18写周期时序
操作注意事项
DDCENA操作
当DDCENA设置为高, SCL_PC0 / 1和SDA_PC0 / 1将被连接到SCL_MON和SDA_MON ,
分别。因此,监测的PC和EEPROM和的通信之间的通信的
显示器和PC ,是可能的。
选择PC0 / PC1的根据的DUALPCB和BANKSEL输入的状态来确定。
当DDCENA是低时,SCL / SDA_MON输出设置为"Hi - Z" 。
SCL_MON , SDA_MON
DUALPCB
BANKSEL
(连接端口)
PC0端口
低( DUAL PORT )
PC1端口
高(单端口)
PC0端口
BANKSEL
BANKSEL作为在双端口模式下输入SCL / SDA_MON的连接端口。
它变成内部存储器中的单端口模式下,银行选择终端。
只有PC0端口可以访问单端口模式下的内存。
DUALPCB
低( DUAL PORT )
高( SINGL PORT )
BANKSEL
连接银行
PC0端口
BANK0
PC1端口
BANK1
BANK0
BANK1
WP
当WP =低电平时,所有的数据在所有地址都是写保护。该终端具有一个内置的下拉电阻器。确保
该WP写入数据时=高。
为了防止从PC不正确的写命令的输入,以及不正确的输入时使用此功能
PC和显示器之间的通信。
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