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K4D263238G-GC
128M GDDR SDRAM
的128Mbit GDDR SDRAM
修订版1.8
2005年3月
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修订版1.8 ( 2005年3月)。
K4D263238G-GC
修订历史
版本1.8 ( 2005年3月5日)
在数据表中的曲线 - •删除80 %和IBIS的120 % ( V I )
128M GDDR SDRAM
版本1.7 ( 2005年2月5日)
•用于驱动器阻抗控制来改变EMRS表。
•增加了IBIS ( I - V)曲线在数据表
版本1.6 ( 2005年1月5日)
• K4D263238G - VC2A的交流特性增加的200MHz / 166MHz的AC特性( II )表
K4D263238G-VC33.
•更正错字
版本1.5 ( 2004年12月29日)
•增加了TCK (分钟) =为5ns @ CL3
•更改TCK K4D263238G - GC2A的(最大) ,从为4ns至10ns的
版本1.4 ( 2004年11月30日)
•直流表错字更正
版本1.3 (十一月十二日,2004年)
•将AC规范的格式
•改变DC规格测量条件,从VDD (典型值)连接到VDD (最大值)
版本1.2 ( 2004年10月18日)
•将tWR的单位和tWR_A从ns至TCK ,以避免误操作。
•增加了低速计时集
版本1.1 ( 2004年8月31日)
•增加了100 %,驱动强度选项为A6A1 = "11"
版本1.0 ( 2004年7月12日)
•定义DC规格
版本0.4 ( 2004年6月20日)
从规格•删除K4D26323QG - GC40 / 45
•增加空周期( 20tCK ) EMRS和刘健之间在上电顺序。
版本0.3 ( 2004年6月8日)
•内部只
版本0.2 ( 2004年4月22日)
• K4D263238G - GC2A的改变CAS延迟时间从4tCK到5tCK
•将tWR的& tWR_A K4D263238G - GC2A从4tCK到5tCK
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修订版1.8 ( 2005年3月)。
K4D263238G-GC
修订历史
版本0.1 ( 2004年4月19日)
• K4D263238G - GC33 / 36变更tRCDRD从4tCK到5tCK
• K4D263238G - GC33 / 36变更tRCDWR从2tCK到3tCK
• K4D263238G - GC2A / 33/ 36 tWR的改变,从3tCK到4tCK 。
• K4D263238G - GC2A的改变tDAL从8tCK到9tCK
• K4D263238G - GC33 / 36变更tDAL从7tCK到8tCK
128M GDDR SDRAM
版本0.0 ( 2004年4月7日)
- 目标规格
•确定的目标规格
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修订版1.8 ( 2005年3月)。
K4D263238G-GC
128M GDDR SDRAM
1M X 32位×4银行图形双数据速率同步DRAM
用双向数据选通和DLL
特点
•2.5V ±5%为设备操作电源
• 2.5V ± 5 %电源的I / O接口
• SSTL_2兼容输入/输出
• 4银行操作
• MRS循环地址重点项目
- 。读取延迟3,4(时钟)
- 。突发长度(2,4和8)
- 。突发类型(顺序&交错)
•除了数据& DM所有输入进行采样,正
将系统时钟的边沿
•差分时钟输入
•无Wrtie -打断读取功能
• 4 DQS的( 1DQS /字节)
•数据I /数据选通信号的两边O事务
• DLL对齐DQ和DQS转换与时钟转换
•边沿对齐的数据&数据选通输出
•中心对齐数据&数据选通输入
• DM只写屏蔽
•自动&自我刷新
• 32ms的刷新周期( 4K周期)
• 144球FBGA
•最大时钟频率高达350MHz的
•最大数据传输率可达700Mbps /针
订购信息
产品型号
K4D263238G-GC2A
K4D263238G-GC33
K4D263238G-GC36
最大频率。
350MHz
300MHz
275MHz
最大数据速率
700Mbps/pin
600Mbps/pin
550Mbps/pin
SSTL_2
144球FBGA
接口
K4D263238G -VC是无铅封装部件编号。
概述
FOR 1M X 32位×4银行DDR SDRAM
该K4D263238G是134217728位超同步数据速率动态随机存储器划分为4 x1,048,576用字
32位,制造与三星
s高性能CMOS技术。有数据选通同步功能可让
极高的性能高达2.8GB / S /芯片。 I / O事务处理可在时钟周期的两端。范围
的工作频率,可编程脉冲串长度和可编程延迟允许该设备可用于各种有用
高性能存储系统的应用程序。
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修订版1.8 ( 2005年3月)。
K4D263238G-GC
引脚配置
( TOP VIEW )
2
B
C
D
E
F
G
H
J
K
L
M
N
DQS0
DQ4
DQ6
DQ7
DQ17
DQ19
DQS2
DQ21
DQ22
CAS
RAS
CS
128M GDDR SDRAM
3
DM0
VDDQ
DQ5
VDDQ
DQ16
DQ18
DM2
DQ20
DQ23
WE
NC
NC
4
VSSQ
NC
VSSQ
VDD
VDDQ
VDDQ
NC
VDDQ
VDDQ
VDD
NC
BA0
5
DQ3
VDDQ
VSSQ
VSS
VSSQ
VSSQ
VSSQ
VSSQ
VSSQ
VSS
BA1
A0
6
DQ2
DQ1
VSSQ
VSSQ
7
DQ0
VDDQ
VDD
VSS
8
DQ31
VDDQ
VDD
VSS
9
DQ29
DQ30
VSSQ
VSSQ
10
DQ28
VDDQ
VSSQ
VSS
VSSQ
VSSQ
VSSQ
VSSQ
VSSQ
VSS
俄罗斯足协
2
A7
11
VSSQ
NC
VSSQ
VDD
VDDQ
VDDQ
NC
VDDQ
VDDQ
VDD
CK
A8/AP
12
DM3
VDDQ
DQ26
VDDQ
DQ15
DQ13
DM1
DQ11
DQ9
NC
CK
CKE
13
DQS3
DQ27
DQ25
DQ24
DQ14
DQ12
DQS1
DQ10
DQ8
NC
MCL
VREF
VSS
VSS
热热
VSS
VSS
热热
VSS
VSS
热热
VSS
VSS
热热
VSS
A10
A2
A1
VSS
VDD
A11
A3
VSS
VSS
热热
VSS
VSS
热热
VSS
VSS
热热
VSS
VSS
热热
VSS
VDD
A9
A4
VSS
俄罗斯足协
1
A5
A6
注意:
1. RFU1保留供A12
2. RFU2保留用于BA2
3. VSS热球是可选的
引脚说明
CK , CK
CKE
CS
RAS
CAS
WE
的DQ
DM
俄罗斯足协
差分时钟输入
时钟使能
芯片选择
行地址选通
列地址选通
写使能
数据选通
数据屏蔽
留作将来使用
BA
0
, BA
1
A
0
~A
11
DQ
0
? DQ
31
V
DD
V
SS
V
DDQ
V
SSQ
NC
MCL
银行选择地址
地址输入
数据输入/输出
动力
电源DQ
s
地面DQ
s
无连接
必须连接低
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修订版1.8 ( 2005年3月)。
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