BU16LVDS [ETC]
マルチメディアLSI ; マルチメディアLSI\n
| 型号： | BU16LVDS |
| 厂家： | 
ETC |
| 描述： | マルチメディアLSI
|
| 文件： | 总5页 (文件大小：157K) |
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BU16LVDS / BU35LVDS Series
マルチメディア IC
LVDS コア内蔵エンベデッドアレイ
65MHz 版
BU16LVDS / BU35LVDS Series
BU16LVDS / BU35LVDS シリーズは低 EMI と低消費電力が求められる TFT パネルのタイミングコントローラとして最
適です。また、カスタムプロトコルにも対応可能なため、低ノイズが要求される様々な電子機器に応用できます。ラン
ダムロジックはユーザブルで 100Kgate 程度までの搭載が可能です。490Mbps の高速データレートに追随できる LVDS
（Low Voltage Differential Signaling）レシーバが内蔵されており、クロック同期にはジッタが 100pSP-P の最新の PLL
回路が使われています。ローム独自の PLL 技術により、ワイドクロックレンジと SS クロック対応の両立に成功しま
した。また、LVDS コアでの消費電力は 100mW（LVDS コア×1、RxCLK=65MHz、内部動作周波数 455MHz 時）と大
変低く、EMI はもとよりバッテリーライフの点でも非常にメリットがあります。
!用途
VGA、SVGA、XGA、SXGA のTFT パネルのタイミングコントローラ
その他、低 EMI が要求される電子機器
!特長
１）新開発のリニア可変フィルタの採用でジッタ耐性が大幅にアップ。
２）Intel Mobile Spec のSS クロックに対応。
３）Windows の画面切り換え時でも安定した動作。
４）VGA、SVGA、XGA、SXGA のTFT パネルに対応。（26 万色から 1677 万色）
５）20MHz から 70MHz のワイドクロックレンジ。（140Mbps～490Mbps）
６）100mW の低消費電力。
７）0.35µmCMOS プロセス。（BU35LVDS；開発中）、0.6µmCMOS プロセス。（BU16LVDS）
８）パワーダウンプロテクト入力により、5V 系の入力が可能。
９）5V 出力、2-PortRAM、電源電圧監視回路などが内蔵可能。
１０）ANSI EIA / TIA-644 に準拠。
!絶対最大定格（Ta = 25°C）
Parameter
Symbol
Limits
4.5
Unit
V
電源電圧
VDD
デジタル電源
アナログ電源電位差
VDA
0.3
V
Pd∗1
Topr
Tstg
許容損失
1200
mW
°C
動作温度範囲
保存温度範囲
0
~ +70
°C
−55 ~ +125
∗1 Ta=25°C以上で使用する場合は、1°Cにつき12mWを減じる。
!推奨動作条件（Ta = 25°C）
Parameter
Symbol
Min.
3.0
Typ.
3.3
Max.
3.6
Unit
電源電圧
V
DD
V
BU16LVDS / BU35LVDS Series
マルチメディア IC
!電気的特性（Ta = 0～70°C, VDD = 3.0～3.6V, RXCLK = 20～70MHZ, Input Clock jitter ≤ 50pSP-P）
Parameter
Symbol
Min.
20
Typ.
Max.
70
Unit
Conditions
クロック周波数
RX
CLK
−
MHz
入力データ
R
X
CLK=65MHz , R
X
V
TH
−
R
X
V
TL=200mV
T
DISKM
−500
−
+500
ps
スキューマージン
RX
V
CM=1.2V , R
TL=200mV，R
CM=0mV，R CK to CKO
X
VCM=0mV
出力クロック
R
R
X
X
V
TH−
RXV
X
VCM=1.2V
T
COJITC
−
150
300
psP-P
Cycle to Cycleジッタ
V
X
このスペックはLVDSコア無負荷単体のものです。
実際のDUTY比はクロックバッファや負荷の影響
を受けます。
出力クロック
デューティ比
T
CODUTY
48
50
52
%
出力データ
T
COSU
4
3
−
ns
ns
セットアップタイム
出力データホールドタイム
T
COH
PLL安定化時間
XRST↑to Lock
T
ENPLL
−
1
ms
差動入力
RXV
TH
−
50
100
mV
“H”スレッショルド
差動入力
R
X
V
TL
−100
1.0
−50
1.2
−
−
mV
V
“L”スレッショルド
差動入力コモンモード電圧
RX
V
CM
1.5
+50
10
R
R
X
V
V
TH
−
−
R
X
V
V
TL=200mV
TL=200mV
差動入力
RX
V
CM
−50
−10
mV
µA
X
TH
RX
コモンモード電位差
差動入力リーク電流
R
X
I
IZ
−
0≤R VIN≤5.5V
X
!応用例
XGA、SVGA のTFT パネルにおけるインターフェース構成例
Cable
BU16LVDS / BU35LVDS
T
T
X
OUT0−
OUT0+
R
X
O0N
O0P
100Ω
100Ω
100Ω
100Ω
RXO [5 : 0] OddR [5 : 0]
電源のフィルタリング例
X
RX
RXO [11 : 6] OddG [5 : 0]
T
T
X
OUT1−
OUT1+
RX
O1N
O1P
VDD
X
RX
R
XO [17 : 12] OddB [5 : 0]
T
T
X
OUT2−
OUT2+
RX
O2N
O2P
DE
O [20 : 18] Vsync
Hsync
to
X
RX
t
R
X
PLL VDD
o
T
X
CLK−
CLK+
RX
OCN
OCP
RXOCLK OddCLK
1µF
0.01µF
L
C
D
T
X
RX
Control
Logic
PLL GND
LVDS Core
D
r
i
to
LVDS VDD
RXE [5 : 0] EvenR [5 : 0]
v
e
r
1µF
0.01µF
RXE [11 : 6] EvenG [5 : 0]
LVDS GND
RXE [17 : 12] EvenB [5 : 0]
DE
E [20 : 18] Vsync
Hsync
to
RX
Digital VDD
RXECLK EvenCLK
1µF
0.1µF
Digital GND
BU16LVDS / BU35LVDS Series
マルチメディア IC
!タイミングシーケンス 1（18bit to 18bit）
RX
CK
Previous Cycle
Next Cycle
RX
RX
RX
D0
D1
D2
R
X
1-1
R
X
0-1
R
X
6
R
X
5
R
X
4
R
X
3
R
X
2
R
X
1
R 0
X
R1-1
R0-1
G0
R5
R4
R3
R2
R1
R0
RX
8-1
R
X
7-1
R
X
13
RX
12
RX
11
RX
10
RX
9
RX
8
RX7
G2-1
G1-1
B1
B0
G5
G4
G3
G2
G1
RX
15-1
R
X
14-1
R
X
20
RX
19
RX
18
RX
17
RX
16
RX
15
RX
14
B3-1
B2-1
EN
Vsync
Hsync
B5
B4
B3
B2
CKO
DOn
DO-2
DO-1
DO
!タイミングシーケンス 2（24bit to 24bit ; 開発中）
RX
CK
Previous Cycle
Next Cycle
RX
RX
RX
RX
D0
D1
D2
D3
R
X
1-1
R
X
0-1
R
X
7
R
X
6
R
X
4
R
X
3
R
X
2
R
X
1
R
X
0
R1-1
R0-1
G0
R5
R4
R3
R2
R1
R0
RX
9-1
R
X
8-1
R
X
18
RX
15
RX
14
RX
13
RX
12
RX
9
RX
8
G2-1
G1-1
B1
B0
G5
G4
G3
G2
G1
RX
20-1
R
X
19-1
R
X
26
RX
25
RX
24
RX
22
RX
21
RX
20
RX
19
B3-1
B2-1
EN
Vsync
Hsync
B5
B4
B3
B2
RX
5-1
RX
27-1
R
X
23
RX
17
RX
16
RX
11
RX
10
RX
5
RX
27
R7-1
R6-1
RSVD
B7
B6
G7
G6
R7
R6
CKO
DOn
DO-2
DO-1
DO
BU16LVDS / BU35LVDS Series
マルチメディア IC
!タイミング定義
RXCK
7
7
×
×
R
X
CLK
CLK
7
RX
6
7
×
RXCLK
5
7
×
RXCLK
4
7
×
RXCLK
3
7
×
RXCLK
2
7
×
RXCLK
1
7
×
RXCLK
RXDn
T
DISKM
T
DISKM
1.5
CLK
T
CODUTY
7
×
R
X
CKO
DOn
T
COJITC
T
COSU
T
COH
DO-2
DO-1
DO
BU16LVDS / BU35LVDS Series
マルチメディア IC
!外形寸法図（Units : mm）
14.0 0.3
12.0 0.2
12.00 0.30
10.00 0.20
16.0 0.3
14.0 0.2
60
41
75
51
48
33
32
17
40
21
76
50
26
49
64
61
80
100
1
16
1
20
1
25
0.125 0.10
0.10
0.125 0.1
0.10
0.125 0.1
0.10
0.2 0.1
0.5
0.20 0.10
0.50
0.5
0.2 0.1
TQFP64V
TQFP80V
TQFP100V
1Pin
MARK
16.0 0.3
14.0 0.2
90
10.0 0.1
9.7
0.8
61
60
L
K
J
91
φ
0.45 0.05
0.08
A
B
H
G
F
E
D
C
B
A
120
31
30
1
2 3 4 5 6 7 8 9 10 11
P = 0.8 × 10
1
0.125 0.1
0.08
1.0 0.15
0.4
0.15 0.1
S
A
TQFP120U
FBGA112 (CSP TYPE1)
0.1
S
1Pin
MARK
13.0
± 0.1
0.8
12.7
P
φ
0.45
± 0.05
N
M
L
0.08
A
B
K
J
H
G
F
E
D
C
B
A
1
2
3
4
5
6
7
8
9 1011121314
P = 0.8 × 13
1.3 ± 0.15
A
FBGA180 (CSP TYPE1)
0.1
S
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